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CPLD在有源电力滤波器中的应用

    随着电力电子技术的飞速发展,电力电子装置的应用日益广泛,引起的谐波污染问题也越来越受到人们的关注。为了提高电能质量,抑制谐波污染,一条基本思路就是装设谐波补偿装置[1]。由于传统的LC滤波器易受电网阻抗和运行状态影响,容易与系统产生并联谐振而且只能补偿固定频率谐波,所以有源电力滤波器已经成为谐波补偿的一种新的发展趋势。有源电力滤波器能够对不同频率的谐波和变化的无功功率进行补偿,同时为了满足谐波检测的实时性、准确性要求,多采用以高速数字信号处理见长的DSP作为系统CPU。但是DSP只有两个I/O口,与多个外围器件的接口扩展受到限制,所以本文采用CPLD设计了DSP系统的组合逻辑电路,实现与外围器件的接口扩展和时序配合,并在QuartusⅡ波形编辑器中完成了系统的时序分析。
    连线时,将DSP的15位低地址线A0~A14直接与SRAM和Flash的A0~A14相连,DSP的A16与外存储器的A15相连,A17与外存储器的A16相连,A18与外存储器的A17相连,这样省去DSP的A15地址线,就将SRAM和Flash分别分成32 KB长的块。以Flash为例,若A15=1,Flash的0000H~7FFFH对应于DSP的8000H~FFFFH,Flash的8000H~FFFFH对应于DSP的18000H~1FFFFH,Flash的10000H~1FFFFH对应于DSP的28000H~2FFFFH,以此类推。

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